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高通電路産生過充的原因

生活 更新时间:2024-12-22 20:18:27

大家好,我是電器電!這篇文章來講一下高通電路波特圖如下圖所示

高通電路産生過充的原因(高通電路波特圖)1

來看一下上圖的幅頻特性曲線當f=fL時Au=1/√2,這時20Ig丨Au丨=-3dB

這是個什麼概念呢?也就是說輸出信号是輸入信号的70%左右就說明此信号基本能完整輸出當f<fL時會以-20dB/dec的速度往下衰減dec讀作每十倍頻程也是頻率路程。-20dB/dec的意思是說每十倍頻程以20dB的速度遞減,當然理想特性是f=fL時就全部切斷。

當f>fL時Au接近于1,20lg丨Au|=0所以可以輸出,f=fL 的點相當于一個轉折點所以fL也稱之為下限截止頻率。

再來看一下圖下的相頻特性當f=fL時φ=45那麼就是相位超前45度當f=0.1fL時距離90度還有5.7度,當f=10fL時距離0度還有5.7度。如果f巜fL那麼相位角趨近于90度,如果f>>fL那麼φ趨近于0度。所以相位最大可移90度。

我們再來看一下電路圖

高通電路産生過充的原因(高通電路波特圖)2

可以看出電容頻率越高,容抗越小。頻率越小容抗越大。Uo輸出相位最大可移90度。

我們再看看φ的由來,φ為什麼等于

90度-arctg(f/fL)

Au=j(f/fL)/(1+jf/fL)①由于分子隻有虛部所以為90°-arctg虛部/實部

∴φ=90°-arctg(f/fL)

最後非常感謝大家的收看!

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