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京瓷打印機芯片

科技 更新时间:2025-02-23 22:42:29

京瓷打印機芯片?DesignWare處理器IP核的集成助力京瓷公司實現超級分辨率圖像處理SoC一次流片成功,我來為大家講解一下關于京瓷打印機芯片?跟着小編一起來看一看吧!

京瓷打印機芯片(EV處理器助力京瓷公司成功推出AI技術多功能打印機SoC)1

京瓷打印機芯片

DesignWare處理器IP核的集成助力京瓷公司實現超級分辨率圖像處理SoC一次流片成功

加州山景城2021年3月26日 /美通社/ --

要點:

  • 京瓷辦公信息系統公司采用高性能DesignWare ARC EV6x處理器IP核和MetaWare EV開發工具包,實現了其智能多功能産品SoC的差異化
  • DesignWare EV6x視覺處理器可集成1到4個512位矢量DSP和一個卷積神經網絡引擎,可為各種視覺應用提供可擴展性能
  • MetaWare EV開發工具包是支持TensorFlow、Caffe、ONNX、OpenCL C、OpenVX和OpenCV标準的一整套工具,可簡化應用軟件開發流程

新思科技(Synopsys, Inc., 納斯達克股票代碼:SNPS)近日宣布,總部位于日本大阪的京瓷辦公信息系統公司(京瓷公司)采用新思科技DesignWare®ARC®EV6x嵌入式視覺處理器IP核,結合卷積神經網絡(CNN)引擎和ARC MetaWare®EV開發工具包,實現了其新多功能産品(MFP)SoC的一次流片成功。 通過使用新思科技的可編程ARC EV處理器,京瓷公司成功集成了超分辨率等高性能人工智能(AI)處理功能,能夠靈活支持未來AI模型。此外,京瓷公司還部署了新思科技HAPS ®基于FPGA的原型驗證系統,以加速ARC EV軟件開發、SoC集成和系統驗證。

京瓷公司軟件開發事業部總經理Michihiro Okada表示:“在我們的MFP SoC中實現高級AI功能需要高性能、低功耗的處理器IP核和高質量的工具鍊,讓我們能夠在并行開發SoC的同時找到并測試AI算法。隻有新思科技的DesignWare ARC EV處理器IP核和成熟的MetaWare EV工具包才能滿足我們對擴展性、性能和面積的要求。”

DesignWare ARC EV6x處理器系列集成了标量、矢量DSP和卷積神經網絡處理單元,可實現高度精确和快速的視覺處理。EV6x處理器支持多種已被廣泛采用的卷積神經網絡,包括SR-GAN、MobileNET、Yolo、GoogLeNet、SSD和ResNet。為了簡化軟件應用程序開發,EV6x處理器由一套全面的工具和軟件DesignWare ARC MetaWare EV開發工具包所支持。工具包内包括MetaWare NN編譯器,可對使用Tensorflow或Pytorch等流行框架進行訓練的神經網絡進行分析,并為可編程的卷積神經網絡自動生成可執行程序。

新思科技IP核營銷和戰略高級副總裁John Koeter表示:“随着新興的人工智能應用被納入最新的高性能神經網絡,開發者需要卓越的硬件技術和軟件工具才能實現SoC的按時交付。我們的AI優化型IP核解決方案能夠實現快速準确的視覺處理,協助京瓷公司等企業更快構建有競争力的産品,并顯著降低風險。”

貨情況和其他資源

DesignWare ARC EV處理器、ARC MetaWare EV開發工具包和HAPS®基于FPGA的原型驗證系統現已推出。

  • 成功案例:DesignWare處理器IP核助力京瓷公司實現按需超級分辨率圖像處理SoC一次流片成功
  • 網站:ARC EV Processor IP核、ARC MetaWare EV Development Toolkit和HAPS-80 FPGA-Based Prototyping
  • 博客:How AI Brings New Life to Low-Resolution Images(人工智能如何讓低分辨率圖像重獲新生)
  • 文章:Enhance Image! Real-time Super Resolution with ARC EV Processor IP核(提升圖片質量!ARC EV處理器IP核實現實時超高分辨率)

新思科技DesignWare IP簡介

新思科技是提供面向片上系統 (SoC) 設計的高質量矽驗證IP核解決方案的領先供應商。廣義上的DesignWare IP核組合包括邏輯庫、嵌入式存儲器、PVT傳感器、嵌入式測試、模拟IP核、有線和無線接口IP核、安全IP核、嵌入式處理器和子系統。為了加速原型設計、軟件開發以及将IP核整合進芯片,新思科技IP核Accelerated計劃提供IP核原型設計套件、IP核軟件開發套件和IP核子系統。新思科技對IP核質量的廣泛投資、全面的技術支持以及強大的IP核開發方法使設計人員能夠降低整合風險,并加快上市時間。DesignWare IP核的更多相關信息請見。

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